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Altera在Quartus II软件6.0高密度设计上实现重大改进
2006/5/22 9:34:43     Altera
(2006年5月,香港)Altera公司(www.altera.com.cn)日前宣布开始发售6.0版的Quartus II软件。该版本包括了由FPGA供应商提供的第一款时序分析工具TimeQuest时序分析仪,为业界标准Synopsys设计约束(SDC)时序格式提供自然、全面的支持。这一最新版本还包括扩展的团队设计功能,能够有效管理高密度设计团队之间的协作。这些改进迎合了当今高密度90nm的设计要求,同时为满足客户对更高密度FPGA的需求以及Altera发展下一代65nm产品系列打下了基础。
    Synopsys战略联盟总监Lonn Fiance评论说:“FPGA设计人员将业界标准SDC时序约束格式直接读取到TimeQuest时序分析仪中,能够更迅速的实现时序逼近。采用SDC格式可以提高FPGA设计人员的效率,进一步促进标准时序验证方法在半导体业界的应用。”
    Altera在最新版Quartus II软件中引入了新的技术改进,以满足客户对90nm的需求,并为65nm工艺节点打下了基础。这些新特性最突出的部分包括:
·TimeQuest时序分析仪:这一新的ASIC功能时序分析仪为业界标准SDC格式提供全面的支持。TimeQuest时序分析仪帮助用户对时序约束较复杂的设计进行建立、管理和分析操作,例如时钟复用设计和源同步接口等,用户还可以迅速完成高级时序验证。Quartus II软件6.0订购版提供TimeQuest时序分析仪。
扩展的团队设计支持: 该设计特性包括工程管理器接口,用于顶层设计的资源管理和时序预算。此外,工程管理器接口还支持设计人员管理模块间的时序约束,实现最佳性能。这一新特性支持团队在高密度FPGA设计上的协作,从而提高了团队效率,增强了设计模块之间的性能。这一特性建立在Quartus II软件5.0中首次引入的渐进式编译设计特性之上。
·SystemVerilog支持: 通过对流行的IEEE 1800-2005标准SystemVerilog语法硬件描述和验证语言设计结构的支持,实现了速度更快的寄存器传送级(RTL)。
·增强的I/O引脚规划器: 与Altera知识产权更直接的集成,简化了引脚分配。
扩展的电路板级设计支持: 提供Stratix II单端输出HSPICE模型,实现效率更高的电路板模型。
·首屈一指的性能表现:与最相近的竞争产品相比,Quartus II软件继续为设计人员的高密度90nm设计提供完整的速率等级,为低成本90nm设计提供三种速率等级。
    Altera亚太区营销市场梁乐观说:“对于那些在高密度、高性能复杂FPGA市场上参与竞争的设计人员而言,Quartus II软件为他们提供了无与伦比的优势。它能够实现当今业界90nm设计最可靠的性能和效率,并为65nm的发展做好了准备。客户信赖Altera能够在Quartus II软件中为他们提供最先进的技术,例如TimeQuest时序分析仪,帮助他们在最短的时间内轻松开发出功能强大的设计。”
    现在可以同时提供Quartus II软件订购版和网络版。订购版6.0向所有客户发售,它带有有效软件订购。可以从www.altera.com/q2webedition上下载免费的Quartus II网络版软件。Altera的软件订购程序将软件产品和维护费用合并在一个年度订购支付中,简化了获取Altera设计软件的过程。订户可以接收到Quartus II软件订购版、ModelSim Altera版以及对IP Base Suite的完整许可——Altera最流行的9个知识产权内核(DSP、存储器和千兆以太网MAC内核)。一个节点锁定的PC许可年度软件订购价格为2,000美金。Quartus II设计软件支持主流的操作系统,包括Windows XP Professional x64、Windows XP、Windows 2000、Sun Solaris 8和9以及Red Hat Linux Enterprise 3.0和4.0。新老客户可以通过Altera分布在世界各地的分销商来获得软件订购。    (完)
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